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DS88高速度啁啾直觀數碼頻率合并器重要性特點 32位頻率調諧字
13位ROM相位地址解析
片上11位DAC
時鐘速率高達4.5 GHz
可在正常保持格式和歸零格式之間選擇的模擬輸出
·對于正常保持模式產生高達2.25GHz的第一奈奎斯特頻帶或對于返回到零模式產生高達6.75GHz的第三奈奎斯特頻帶。
在4 GHz時鐘速率下，寬帶最差SFDR接近50 dBC（DC到2-GHz帶寬）
50個后端的互補模擬波形輸出
同步芯片/N同步多芯片應用
SyCOOYP/N為數據加載和同步選通信號提供參考。
LVTTL/CMOS數字模式控制輸入
異步復位（RST）引腳啟動階段0（與IQSL =低）或90（與IQSL =高）啟動狀態
·頻閃輸入（STRBUP/N）以更新頻率字和DAC輸出頻率
●寬數據加載窗口允許DS878由存儲器、微控制器、FPGA或DSP芯片控制，以在頻率轉換期間不發生時鐘滑移或故障地最快更新8個時鐘周期。
4.3瓦的功耗與單-5V電源
64引腳QFN 9X9打包封裝

DS88高速啁啾直接數字頻率合成器描述
DS878是一種高速直接數字合成器（DDS），頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC的模擬輸出可以在正常保持模式(對于第一奈奎斯特頻帶)和歸零模式(對于第一、第二和第三奈奎斯特頻帶)操作之間選擇。正弦波可以產生高達第一奈奎斯特帶近1.8 GHz（在3.6GHz時鐘速率）
正常保持(chi)模(mo)式的(de)(de)DAC或高達(da)第(di)三(san)奈奎斯特帶約5.4 GHz的(de)(de)返(fan)回到(dao)零模(mo)式的(de)(de)DAC。初始階(jie)段可以重置(zhi)為零度開始。該芯片(pian)(pian)有(you)一對互(hu)補模(mo)擬(ni)輸(shu)出(chu)50Ω后端。輸(shu)出(chu)波形的(de)(de)頻率(lv)可以由(you)三(san)十二個(ge)頻率(lv)控制(zhi)位控制(zhi)，VI[0:31]。DS878接(jie)受(shou)差分時(shi)鐘輸(shu)入(ru)或單端時(shi)鐘輸(shu)入(ru)，并(bing)(bing)且具有(you)具有(you)用(yong)(yong)戶定(ding)義(yi)的(de)(de)閾(yu)值(zhi)的(de)(de)50-片(pian)(pian)上后端子。頻率(lv)分辨率(lv)位接(jie)受(shou)LVTTL或CMOS輸(shu)入(ru)電(dian)平(ping)。差分同步(bu)(bu)輸(shu)入(ru)SyncI_P/N為多個(ge)芯片(pian)(pian)應(ying)用(yong)(yong)提供同步(bu)(bu)，并(bing)(bing)且啟動(dong)(dong)每個(ge)芯片(pian)(pian)準備接(jie)受(shou)頻率(lv)字輸(shu)入(ru)。同步(bu)(bu)選通輸(shu)入(ru)由(you)內部產(chan)生的(de)(de)8分頻時(shi)鐘的(de)(de)過渡邊鎖(suo)存，這(zhe)些時(shi)鐘也被發(fa)送(song)到(dao)輸(shu)出(chu)管腳SyncO_P/N。SyncO_P/N.可以用(yong)(yong)作參考來同步(bu)(bu)頻率(lv)字和選通信號輸(shu)入(ru)定(ding)時(shi)與內部分頻8cl的(de)(de)對準。鎖(suo)正確。復(fu)位是異步(bu)(bu)的(de)(de)，以最小化模(mo)擬(ni)輸(shu)出(chu)的(de)(de)時(shi)鐘延遲的(de)(de)有(you)效性。優化內部時(shi)序以避免頻率(lv)字過渡或復(fu)位后的(de)(de)時(shi)鐘滑動(dong)(dong)。只(zhi)需要一個(ge)單一的(de)(de)5V電(dian)源。