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MD657B是一個款繞城高速路12四位數模換算器（DAC），集成功了48:12（12路4:1）輸入多路重復使用器。片上DAC能否在大過6.0gsps的監測率下運行。DAC的仿真所在的可在常見做到形式（用以最奈奎斯特頻譜）或復位形式（用以最、第二點和第二奈奎斯特頻譜）左右考慮。差得分篇幅長短據輸入接口標準與LVPECL、LVDS和CML兼容。在48對差得分據輸入被多路重復使用到4倍的加速度后，12繞城高速路統計資料位被鎖存并簡碼以驅使DAC所在的級。同質所在的可與50瓦所在的后殼終端門店。提拱除4的秒表所在的和監測相位考慮（SEL1和SEL2），以簡單化針來說于輸入統計資料的監測相位的兩端對齊。還提拱了除8的秒表所在的。針來說必須要導入若干MD657B所在的的體統利用系統，提拱了重制基本功能。

首要優勢特點·DAC不同設置位的4:1復接比列·12位辯別率DAC高達到>6.0 Gsps效率·DAC模擬訓練效果文件類型可在順利持續（NH）的形式 或回零（RZ）的形式 之前選取·帶50瓦正背終高端的相互依存輸出電壓·能提供互替的除4和除8的鬧鐘效果使用資料關聯·2.75W顯卡功耗·可變性400~800mvpp單端打印輸出擺幅·各個差分輸入數據顯示和歸位對范圍內的心片上100歐姆消費終端·低好推遲了：從數據分析采集點逐漸開始測算幾個掛鐘周期時間或少些·低好相位噪音分貝·LQFP包，帶顯露墊